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一种改进的Wallace树型乘法器的设计 预览 被引量:10
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作者 赵忠民 林正浩 《电子设计应用》 2006年第8期 113-116,共4页
本文针对典型32位乘法,对Booth算法产生的部分积重新合理分组,采用CSA和4-2压缩器的混合电路结构,对传统的Wallace树型乘法器进行改进,提出一种高速的树型乘法器结构。该结构与传统Wallace树型乘法器相比,具有更小的延时、更规整... 本文针对典型32位乘法,对Booth算法产生的部分积重新合理分组,采用CSA和4-2压缩器的混合电路结构,对传统的Wallace树型乘法器进行改进,提出一种高速的树型乘法器结构。该结构与传统Wallace树型乘法器相比,具有更小的延时、更规整的布局和更规则的布线,使其易于VLSI实现。 展开更多
关键词 BOOTH算法 WALLACE树 CSA 4-2压缩器 树型乘法器
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MCG爵士三新碟 预览
2
作者 王士昭 《音响世界》 2004年第9期 66-69,共4页
MCG? 对,是MCG——全称为MANCHESTER CRAFTSMEN′S GUILD,即“曼彻斯特技工协会”。“技工协会”?这跟爵士乐有关系吗? 有,而且有很大关系。
关键词 曼彻斯特 爵士乐 协会 技工
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千年埃及雕像能自转
3
作者 李奇 《科学大观园》 2013年第14期62-62,共1页
英国曼彻斯特博物馆一尊古埃及雕像在展示柜中"自转",引起多名研究人员关注。据英国《每日电讯报》报道,这尊在英国曼彻斯特博物馆收藏了80年之久的,高约25.4厘米古埃及雕像,最近被发现会在展示柜中自己转动。英国《每日电讯报》媒体... 英国曼彻斯特博物馆一尊古埃及雕像在展示柜中"自转",引起多名研究人员关注。据英国《每日电讯报》报道,这尊在英国曼彻斯特博物馆收藏了80年之久的,高约25.4厘米古埃及雕像,最近被发现会在展示柜中自己转动。英国《每日电讯报》媒体网站上传的一段视频显示,这尊深褐色站立雕像人会缓缓转动。录制这段视频的博物馆埃及古物学者坎贝尔·普赖斯介绍,这种雕像通常与木乃伊一同放在陵寝中。"有一天我发现,这尊雕像转变了方向。我觉得奇怪,因为这一展柜只有我有钥匙……第二天我把它放回原样,它又动了。 展开更多
关键词 古埃及 雕像 自转 曼彻斯特 视频显示 博物馆 研究人员 媒体网站
"前导零预测——并行修正"算法中错误的分析和修正 预览
4
作者 凌智强 谈民 曾献君 《计算机研究与发展》 EI CSCD 北大核心 2007年第z1期 31-34,共4页
前导零预测(又称前导-预测)逻辑电路是提高浮点加法器性能的关键.Bruguera和Tomas Lang提出了一种并行修正的算法.该算法结构清晰,且能减少预测的延时.但是该算法存在一个设计失误从而将导致错误的结果.于是分析了错误形成的原因,改进... 前导零预测(又称前导-预测)逻辑电路是提高浮点加法器性能的关键.Bruguera和Tomas Lang提出了一种并行修正的算法.该算法结构清晰,且能减少预测的延时.但是该算法存在一个设计失误从而将导致错误的结果.于是分析了错误形成的原因,改进了算法并证明了改进的正确性. 展开更多
关键词 前导零预测 并行修正
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16×16位带符号/无符号基于RTL级实现的可综合的高速乘法器 预览 被引量:1
5
作者 石碧 程伟综 何晓雄 《电子工程师》 2003年第6期 58-62,共5页
提出了一种综合使用改进后的Booth编码算法、Wallace树形结构、先行进位加法器,利用HDL进行RTL级的高速运算的乘法器的设计.它可以方便地应用于不同的工艺库.逻辑设计与工艺设计是互不相关的.设计的代码经过仿真和综合后表明,采用TSMC 0... 提出了一种综合使用改进后的Booth编码算法、Wallace树形结构、先行进位加法器,利用HDL进行RTL级的高速运算的乘法器的设计.它可以方便地应用于不同的工艺库.逻辑设计与工艺设计是互不相关的.设计的代码经过仿真和综合后表明,采用TSMC 0.18 μm的工艺库在温度为25℃,电源电压为1.8 V的情况下,最小延迟(critical path)为3.5 ns,在时钟频率为200MHz时,芯片面积为26277.0957μm2,平均功耗为7.123 mW. 展开更多
关键词 BOOTH编码 Wallace树形结构 先行进位 加法器 乘法器 符号扩展位
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基于FPGA的全加器硬宏设计及优化 被引量:1
6
作者 卫星 苏先海 《通信技术》 2010年第10期155-157,共3页
现场可编程门阵列(FPGA)是目前应用非常广泛的一种专用集成电路。在FPGA平台上实现了2位全加器硬宏的设计,同时深入FPGA平台底层对该全加器硬宏所占用的切片资源和响应时间进行了优化,并且从逻辑上证明了该设计的正确性。在此基础上,... 现场可编程门阵列(FPGA)是目前应用非常广泛的一种专用集成电路。在FPGA平台上实现了2位全加器硬宏的设计,同时深入FPGA平台底层对该全加器硬宏所占用的切片资源和响应时间进行了优化,并且从逻辑上证明了该设计的正确性。在此基础上,可以非常方便地使用该硬核搭建任意2n位的全加器。最后通过该设计的应用与仿真,再次验证了其高效性和正确性,从而实现了最初的目的,即大幅度地提高基于FPGA的全加器设计的密度和速度。 展开更多
关键词 全加器 硬宏 现场可编程门阵列 切片
基于DSP Builder的双曲正切函数的FPGA实现 预览
7
作者 殷凡姣 顾强 +2 位作者 李美蓉 高超 侯林源 《电子质量》 2015年第8期66-70,共5页
为了保证双曲正切函数在FPGA上实现时能够获得较高的精度和较快的速度,并且消耗较少的资源,在分析现有实现方法优缺点的基础上,提出了分段逼近线性近似法。首先,在理论上,分析了该方法所能达到的精度,给出了数据的定点表示方法。然后,通... 为了保证双曲正切函数在FPGA上实现时能够获得较高的精度和较快的速度,并且消耗较少的资源,在分析现有实现方法优缺点的基础上,提出了分段逼近线性近似法。首先,在理论上,分析了该方法所能达到的精度,给出了数据的定点表示方法。然后,通过Altera公司的系统级数字信号处理,开发工具DSP Builder搭建系统模型并转换得到相应的VHDL代码。最后,通过Modelsim进行时序仿真,验证了该方法的正确性和可行性。结果表明,该方法仅占用芯片EP4CE10F17C8L约1%的逻辑资源,完成一次运算仅需9.88ns,近似计算的最大绝对误差为4e-6。 展开更多
关键词 双曲正切函数 分段逼近线性近似 DSP BUILDER FPGA
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“时代中国”耳机漫步
8
《Design:产品设计》 2008年第6期 138,共1页
“时代中国”耳机漫步声音艺术作品“熟悉(不熟悉)的区域”将从5月24日至6月22日在英国曼彻斯特展出。聆听者可以一边欣赏曼彻斯特城市中心的景象,一边从耳机中听到上海或哈尔滨街头的声音。这些由中国著名声音艺术家颜峻和张立明(H... “时代中国”耳机漫步声音艺术作品“熟悉(不熟悉)的区域”将从5月24日至6月22日在英国曼彻斯特展出。聆听者可以一边欣赏曼彻斯特城市中心的景象,一边从耳机中听到上海或哈尔滨街头的声音。这些由中国著名声音艺术家颜峻和张立明(Hidike)细心编辑的声音作品与曼彻斯特城市中心的景点相连,使整个耳机漫步行程为半小时。作品利用他们在各自城市的市场、街道、餐厅和工业区中捕捉到的一些声音。 展开更多
关键词 耳机 中国 曼彻斯特 艺术作品 城市中心 声音 哈尔滨 艺术家
一种运用现场可编程(FPGA)技术实现的运算器 预览
9
作者 何海 《集成电路应用》 2000年第2期 28-30,34,共4页
本文介绍来用现场可编程FPGA技术实现的数学运算器的方法,详细地描述了它的工作原理、工作过程及其性能,并给出在雷达中的应用实例。
关键词 FPGA 运算器 工作原理
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MULTIPLIER OPERATORS AND EXTREMAL FUNCTIONS RELATED TO THE DUAL DUNKL-SONINE OPERATOR 预览
10
作者 Fethi SOLTANI 《数学物理学报:B辑英文版》 SCIE CSCD 2013年第2期430-442,共13页
We study the dual Dunkl-Sonine operator tSk, on Rd , and give expression of tSk,e1 , using Dunkl multiplier operators on R d . Next, we study the extremal functions fμλ , λ> 0 related to the Dunkl multiplier ope... We study the dual Dunkl-Sonine operator tSk, on Rd , and give expression of tSk,e1 , using Dunkl multiplier operators on R d . Next, we study the extremal functions fμλ , λ> 0 related to the Dunkl multiplier operators, and more precisely show that {fμλ}λ>0 converges uniformly to tSk,e(f) as λ→ 0 + . Certain examples based on Dunkl-heat and Dunkl-Poisson kernels are provided to illustrate the results. 展开更多
关键词 极值函数 运营商 乘法器 操作 乘数 电子 收敛
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基于FPGA的全流水双精度浮点矩阵乘法器设计 预览 被引量:2
11
作者 刘沛华 鲁华祥 +1 位作者 龚国良 刘文鹏 《智能系统学报》 北大核心 2012年第4期302-306,共5页
在数字通信、图像处理等应用领域中需要用到大量的矩阵乘法运算,并且它的计算性能是影响系统性能的关键因素.设计了一个全流水结构的并行双精度浮点矩阵乘法器以提高计算性能,并在Xilinx Virtex-5 LX155现场可编程门阵列(FPGA)上完成... 在数字通信、图像处理等应用领域中需要用到大量的矩阵乘法运算,并且它的计算性能是影响系统性能的关键因素.设计了一个全流水结构的并行双精度浮点矩阵乘法器以提高计算性能,并在Xilinx Virtex-5 LX155现场可编程门阵列(FPGA)上完成了方案的实现.乘法器中处理单元(PE)按阵列形式排列,在一个FPGA芯片上可集成10个PE单元实现并行计算.为了提高工作频率,PE单元采用流水线结构,并运用C-slow时序重排技术解决了环路流水线上"数据相关冲突"的问题.仿真结果表明,该乘法器的峰值计算性能可达到5 000 MFLOPS.此外,对不同维数的矩阵乘法进行了实验,其结果也证实了该设计达到了较高的计算性能. 展开更多
关键词 矩阵乘法 现场可编程门阵列(FPGA) 环路流水线 C-slow时序重排技术 乘法器设计
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四象限变频电控装置的应用和改进 预览 被引量:1
12
作者 黄少廷 李砚卿 《科技信息》 2011年第9期 82,共1页
十三矿钢缆乘人皮带选用的交—直—交四象限变频电控系统,技术含量高,具有速度可调、频率可控制、能量可回馈电网、启动,运行,制动实现可靠控制等特点,但由于该电控系统是高精度电子调速设备,保护系统非常灵敏,所以该电控抗干扰能力差,... 十三矿钢缆乘人皮带选用的交—直—交四象限变频电控系统,技术含量高,具有速度可调、频率可控制、能量可回馈电网、启动,运行,制动实现可靠控制等特点,但由于该电控系统是高精度电子调速设备,保护系统非常灵敏,所以该电控抗干扰能力差,易出现误动作,针对存在的弊端,该矿采用抗干扰材料和特质配件加强变频器抗干扰能力,取得了巨大的社会效益和经济效益。 展开更多
关键词 研发 应用 改进 创新
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神经网络求解逆运算问题的能力 预览 被引量:1
13
作者 姚天任 孙洪 《信号处理》 CSCD 北大核心 1995年第1期 44-49,共6页
用正运算方法求解逆运算问题是一值得重视的问题,本文分析了反馈型神经网络在解计算问题方面所具有的这一独特性质,利用这一概念可用模拟电路的神经网络构成一些崭新的高速运算器。本文给出三个实例,其一是由乘法运算构成除法器;其... 用正运算方法求解逆运算问题是一值得重视的问题,本文分析了反馈型神经网络在解计算问题方面所具有的这一独特性质,利用这一概念可用模拟电路的神经网络构成一些崭新的高速运算器。本文给出三个实例,其一是由乘法运算构成除法器;其二是由矩阵参数逆矩阵问题其三是用简单的求余数运算组成其逆运算器,即解中国余数定理网络,这种网络的特点是以及简单的正运算方法完成复杂的逆运算,使设计变得简单,在一些情况下可省去传统逆运算 展开更多
关键词 神经网络 反馈网络 模拟电路 运算器 逆运算
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培训评估调查数据的四象限分析 预览 被引量:1
14
作者 齐建国 《石油化工管理干部学院学报》 2005年第1期 48-52,共5页
对培训进行评估是不断提高培训质量的有效途径,而正确分析评估数据又是保证评估价值的有力手段.四象限分析法是对调查数据进行处理的一种方法,该分析法对培训评估调查数据的处理有借鉴意义.利用四象限分析法处理培训评估调查数据,其核... 对培训进行评估是不断提高培训质量的有效途径,而正确分析评估数据又是保证评估价值的有力手段.四象限分析法是对调查数据进行处理的一种方法,该分析法对培训评估调查数据的处理有借鉴意义.利用四象限分析法处理培训评估调查数据,其核心思想是找出那些均值低但相关系数高的评价项,为以后的培训决策提供依据. 展开更多
关键词 调查数据 四象限 分析法 培训质量 分析评估 借鉴意义 相关系数 行处理 均值
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Study and Evaluation in CMOS Full Adders 预览
15
作者 陈国章 陈昊 何丕廉 《天津大学学报:英文版》 EI CAS 2003年第1期 54-57,共4页
Low power adder circuits, SERF, 10T-Ⅰ,10T-Ⅱ,10T-Ⅲ and a complementary adder (28T) at physical layout level are evaluated. Simulations based on the extracted adder circuit layouts are run to assess how various circu... Low power adder circuits, SERF, 10T-Ⅰ,10T-Ⅱ,10T-Ⅲ and a complementary adder (28T) at physical layout level are evaluated. Simulations based on the extracted adder circuit layouts are run to assess how various circuit setups can impact the speed and power consumption. In addition, impacts of output inverters on the circuit performance of modified SERF and 10T adders due to threshold loss problem are also examined. Differences among these adders are addressed and applications of these adders are suggested. 展开更多
关键词 CMOS 全加法器 28T加法器 电路图 评价
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《指数运算电路的设计》实验综述报告 预览
16
作者 王鹏 唐飞 《科技风》 2012年第3期 214,共1页
本文阐述了《指数运算电路的设计》的实验要求、实施条件、实验步骤和实验结果。指数运算电路应用在很多实时控制和物理量的检测电路中,对控制检测的精度都到决定性的作用。
关键词 模拟信号 运算电路 指数运算 电路设计
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通用乘法器IP核可测性设计研究 预览 被引量:2
17
作者 张弘 杨莉 李玉山 《西安电子科技大学学报》 EI CAS CSCD 北大核心 2003年第3期 349-352,共4页
为了改善所研制的运动视觉系统芯片(SOC)中乘法器IP的可测性,采用基于内建自测试的方法,在外围增加改进的线性反馈移位寄存器和多输入特征寄存器,对乘法器IP内部进行测试.所实现的测试结构对乘法器的内部结构和运算速度影响很小,而且测... 为了改善所研制的运动视觉系统芯片(SOC)中乘法器IP的可测性,采用基于内建自测试的方法,在外围增加改进的线性反馈移位寄存器和多输入特征寄存器,对乘法器IP内部进行测试.所实现的测试结构对乘法器的内部结构和运算速度影响很小,而且测试结构所占的比例也很小.仿真实验的结果表明,这种乘法器IP的可测性设计方法对提高测试覆盖率非常有效. 展开更多
关键词 乘法器 IP核 可测性设计 内建自测试 线性反馈移位寄存器 多输入特征寄存器
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可编程时钟乘法器 预览
18
《今日电子》 2008年第12期 106,共1页
NB3N3020是一款可编程时钟乘法器,这器件在同颗器件上产生低压正射极耦合逻辑(LVPECL)时钟及低压互补金属氧化物半导体(LVCMOS)时钟。这器件含有三个三电平LVCMOS单端选择引脚,设定26种可能时钟频率中的一种,从而为设计人员提供... NB3N3020是一款可编程时钟乘法器,这器件在同颗器件上产生低压正射极耦合逻辑(LVPECL)时钟及低压互补金属氧化物半导体(LVCMOS)时钟。这器件含有三个三电平LVCMOS单端选择引脚,设定26种可能时钟频率中的一种,从而为设计人员提供灵活性,帮助他们满足设计要求,以及采用单颗定制器件替代不同系统中的多个时钟。NB3N3020可编程时钟乘法器拥有8~210MHz的宽输出频率范围。 展开更多
关键词 可编程时钟 乘法器 互补金属氧化物半导体 设计人员 时钟频率 频率范围 器件 三电平
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一个混沌系统仿真研究及其电路分析 预览 被引量:1
19
作者 吴国增 段树民 《电子测试》 2010年第10期 43-46,共4页
分析了Liu混沌系统动力学特性,首先对系统的数值特性进行了分析和研究。通过数值分析可以得到系统是混沌的。给出了MultiSim10.1软件实验系统的拓扑结构,并进行了硬件电路的设计和电路仿真研究。电脑仿真技术为研究非线性系统提供了可... 分析了Liu混沌系统动力学特性,首先对系统的数值特性进行了分析和研究。通过数值分析可以得到系统是混沌的。给出了MultiSim10.1软件实验系统的拓扑结构,并进行了硬件电路的设计和电路仿真研究。电脑仿真技术为研究非线性系统提供了可行的方案,此实验系统具有良好的实验效果,与传统的自治混沌系统相比,此系统具有参数调节方便、易实现、可靠性高,实时性好等优点。 展开更多
关键词 混沌系统 MultiSim10.1 自治混沌系统
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PABLE:一种异步总线的设计与实现 预览
20
作者 张光达 王友瑞 +2 位作者 石伟 王志英 陆洪毅 《计算机工程与科学》 CSCD 北大核心 2013年第5期34-40,共7页
异步电路能够解决同步电路中时钟偏移、功耗过高等问题,且具有平均情况下的性能。为了实现芯片上异步模块之间的全异步通信,发挥异步电路功耗与性能上的优势,设计了一款部分兼容AM—BAAHB总线协议的异步总线PABLE。通过使用流水线结... 异步电路能够解决同步电路中时钟偏移、功耗过高等问题,且具有平均情况下的性能。为了实现芯片上异步模块之间的全异步通信,发挥异步电路功耗与性能上的优势,设计了一款部分兼容AM—BAAHB总线协议的异步总线PABLE。通过使用流水线结构提高总线性能,并着重研究异步仲裁电路,最终采用解同步的异步电路设计方法对PABLE进行了实现。实验结果表明,在UMC0.18μm CMOS工艺下,对于单次数据读写操作,在大于60%的情况下,PABLE总线的读写延迟要低于同步总线;与相同功能的同步总线相比较,PABLE总线的平均功耗下降了约41%。 展开更多
关键词 异步总线 流水线 仲裁器
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